![](https://skos.ii.uni.wroc.pl/pluginfile.php/60807/course/overviewfiles/bobz-01.gif)
Wykład jest wprowadzeniem do projektowania układów cyfrowych przy użyciu języka opisu sprzętu Verilog oraz ich implementacji na układach FPGA. W ramach zajęć student nauczy się również metod testowania sprzętu oraz zapozna się z podstawami formalnej weryfikacji układów cyfrowych.
- Nauczyciel: Marek Materzok